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FPGA VHDL、verilog哪种语言比较常用和易学
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位优秀工程师
FPGA VHDL、verilog哪种语言比较常用和易学
最帅的廖先生
2018-12-01
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FGPA/CPLD
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donatello
肯定是verilog,原子新出的FPGA开发板也是verilog的,难度相对VHDL要简单。
发布于
2018-12-25
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其他答案
数量:
5
xdsnet
这两种都常用(有不同厂商体系支持),也都不是太易学
发布于
2018-12-03
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chen0000009
个人比较喜欢用verilog,其实两种语言差不多的,基本的思想是一样的
发布于
2018-12-11
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yhj416606438
verilog好学,现在都是学这个的,以前只有vhdl没有办法
发布于
2019-01-04
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菜鸟冷虎
其实都是差不多的,语言不是关键,关键的是编程的思想
发布于
2019-01-10
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Harriet
VHDL相对来说还是简单一点,也更容易理解一点
发布于
2019-01-12
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