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FPGA与DSP28335进行双口RAM通信

aaaxxxrrr 2019-04-14 浏览量：2788
前一段时间调试DSP28335与xilinx fpga进行双口RAM通信，fpga调用双口ram IP核，时钟配置为75M，DSP的xintf接口的时钟配置为150M或者75M，但是在150M时两端通信才稳定，75M时配置时数据不稳定，有什么解决方法吗
FGPA/CPLD
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  • 按道理，应该是快的时钟不稳定，慢的时候稳定，你这个相反的原因可能是与FPGA的时序匹配不太对，才会有数据出错的
    • 发布于 2019-04-14
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aaaxxxrrr 回复了 这是经国：FPGA调用的IP核，仿真时读写数据是OK的，现在是DSP读取数据用13个CLK，写数据12个CLK，还想寻求一下改进的方法 回复

其他答案 数量：1
  • 感觉应该是时序上的问题，可以使用逻辑分析仪看一下通讯的时序波形，看是不是时序不匹配的问题。
    • 发布于2019-04-15
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