汉云
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allegro中设置等长时,Rel Prop Delay与 Prop Delay的区别是什么?
菊花链的拓扑,两片DDR3,怎么设置分段等长规则呢从CPU到DDR1再到DDR3的两段等长。使用pin pair的方式,规则检测的与实际的布线长差差距很大
如下这两片的DDR,从芯片出来,100mil不到,就到了DDR芯片,由于芯片的引脚间距问题,是无法达到3W规则的,这种都是怎么布线的,可以不按3W布线的么?还是说,这些都是10层以上的板子,要使用埋孔与半孔呢?