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FPGA有个时序采集问题，球解答？

泰国看星星 2017-04-27 浏览量：789
在使用quartus的时候，工程编好了，下板也完成了，想要采集运行一段时间后，这段时间的时序，我在软件的哪里可以找到啊？
FGPA/CPLD
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  • 建议使用内部逻辑分析仪 signaltapII去抓取 想监测的信号~ modelsim 仅仅只是仿真，不能表示实际运行状态~
    • 发布于 2017-04-27
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其他答案 数量：1

  • 您好,用modelsim就可以看所有時序和接腳訊號了

    供參考

    • 发布于2017-04-27
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