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学习FPGA用Verilog还是vhdl语言好,哪个用的广泛
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位优秀工程师
学习FPGA用Verilog还是vhdl语言好,哪个用的广泛
wg3613
2021-04-04
浏览量:1173
学习FPGA用Verilog还是vhdl语言好,哪个用的广泛
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FGPA/CPLD
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一笔之名也
verilog与C更近一些,学习起来更容易一些
对于FPGA,这两个都是可以的
发布于
2021-04-09
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其他答案
数量:
5
xdsnet
其实要看你用那个芯片和开发工具。 如果入职后就看公司提供那个工具。
发布于
2021-04-04
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耳根的耳根
国内的话,
Verilog
应该用的多一点,你学习的话,用哪个都可以。都能达到学习FPGA的目的。
发布于
2021-04-04
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yhj416606438
现在都Verilog需要开发的
发布于
2021-04-04
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山河
建议从verilog开始,后期有余力再看看VHDL。一般的要求是verilog开发,VHDL能看懂。
发布于
2021-04-05
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莱克迷KW
一般的都是支持的,FPGA哪种语言都可以进行开发,两种语言的差异也不是很大,硬件相关性比较大的是VHDL
发布于
2021-04-12
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