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宫梓萱

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他的提问 162 丨他的回答328

verilog语法问题

宫梓萱

2019-01-24

例如：always@( posedge sys_clk20m or negedge sys_rst) if( !sys_rst ) begin ReadClk20m_Cnt<=5'd0; Temp_Buff <=24'd0; end else Temp_Buff[23-ReadClk20m_Cnt]<=data_port; Temp_Buff[23-ReadClk20m_Cnt]<=data_port;这条语句能不能在一个周期（50ns）内执行完.怎么判断一条语句可以在一个周期内执行完

我的stm32f429主频只能跑到144Mzh

宫梓萱

2019-01-11

我使用的是20MHZ有源晶振。晶振输出没问题是20MHZ。当我用MCO0管脚输出二分频却是72MHZ。也就是主频是144MHZ。我配置的代码是野火的 RCC_MCO1Config(RCC_MCO1Source_PLLCLK RCC_MCO1Div_4);这个函数。并且也在stm32f4xx.h里的宏定义中将默认的25MHZ改成了20MHZ。