glenxu
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你可以定义,连续读3次时钟为高电平,可以定义为空闲,另外,有库函数可以查询空闲状态
看你的开发方向了,建议入门用最小系统,试验方便不心疼。
去耦设计问题:可能是电容设计分布位置不当。或者测量时参考地没选好。
各位说的都对,重点是3V的1117输入不能太高,除非电流很小。用任何其它方案入78M05等将12V转成5V,或采用高效的DC/DC模块输出5V,都行。但建议不要直接用DC/DC得到3.3,否则纹波很大系统不稳定
用个运放,4个电阻输入,增益都是1/4完了!