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DSP如何选择外部时钟?

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cyclone ii 的PLL时钟相位延迟问题

我使用megawizard生成PLL,外部50M,生成3个依次延迟90度的100M时钟,C0 0度, C1 90度 ,C2 180度,然后使用modelsim 门级仿真,出来的结果不太对啊!不应该是依次延迟1/100M/4么?RTL级仿真是对的。。这该如何解决。。再调那个相位值?